IP核（Intellectual Property core）是一段具有特定电路功能的硬件描述语言程序，常常被用于数字电路中。该程序与集成电路工艺无关，可以移植到不同的半导体工艺中去生产集成电路芯片，从而帮助开发人员减少工作量，并加快产品上市。
在以往文章中，我们介绍了高可靠性无缝冗余协议HSR（IEC 62439-3-Clause 5）的相关概念。这是一项兼容性好、易于使用的冗余协议，能够通过环形网络双向发送数据包来提供冗余。在环中断的情况下，支持HSR的目标节点则通过另一个端口接收帧。
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但是，如果时序和带宽使用限制很严格，则需要在HSR节点中添加时序平面，以便按计划的方式传送数据流量。IEEE 1588协议推动了构建确定性 HSR 解决方案的进行，该解决方案专注于电力或国防等关键行业，比起通用的TSN解决方案，这些行业更倾向于使用HSR等更简单的基于硬件的强大解决方案。
基于此，虹科推出了确定性HSR IP核（DHSR IP core）。这是一个基于硬件的专有解决方案，针对可重构设备进行了优化，如果 IEC 发布确定性高可靠性无缝冗余的最终互操作标准，则可以进行升级。
Key Features
虹科DHSR IP core的关键特性
• HSR中的确定性精确帧发送
• 基于精确时钟同步的循环时分复用
• HSR/PRP 交换机 IP core中列出的常规功能：点击查看虹科方案 | 虹科HSR/PRP IP核：全硬件解决方案，可在低成本的FPGA上实现
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虹科HSR-PRP交换机IP核
虹科HSR-PRP交换机IP核是一个完整的硬件解决方案，可实现高可靠性无缝冗余协议和并行冗余标准，并能够在低成本的FPGA上实现。它通过硬件来交换帧，这样可以提供很高的交换速度，同时这也是实现变电站自动化的过程总线和机架间总线的最大允许使用年限和数据完整性所必需的。它是针对能源市场设备的一种灵活解决方案，该设备将连接到HSR环、PRP局域网或在IEC 61850的环境下起到网桥的作用。
