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VU13P+47DR PCIE接口光纤处理板

jf_60352890 来源:jf_60352890 作者:jf_60352890 2025-12-29 12:00 次阅读
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信号处理模块支持插入标准的服务器中使用,也可以+12V供电独立供电使用,支持多卡级联。模块基于VU13P+47DR架构,对外接口有PCIe3.0×16、PCIe4.0×8(国产器件)、40G/100G/200G以太网、千兆以太网、GPIO和串口等。FPGA搭载2组80bit位宽+1组32位宽的DDR4存储器,2个FMC+(兼容FMC子板)接口,满足VITA57.1和VITA57.4规范(只全互联了LA[33:0]和GTY[15:0]),支持标准的FMC或FMC+子卡接入。全部器件选择工业级和以上质量等级元器件

wKgZO2lR_CeAXuBfAAH87FGWCok191.png

应用行业:

软件无线电SDR、无线通信原型验证、算法验证

频谱监测测向、雷达侦察定位、卫星调制解调

数据采集存储、波形生成与回放

产品特点:

支持8收(5Gsps@14bit)8发(9.8Gsps@14bit)的宽带AD/DA

2个FMC+接口,满足双宽规范

3组DDR4,其中两组位宽80bit,1组位宽32位

支持PCIe3.0x16、40G/100G/200G等高速接口

支持多卡级联(通过MICO或光纤口)

板载PLL,支持外参考同步所有的GTY时钟

支持通过以太网远程更新固件程序

支持监控状态监控

单电源+12V供电,支持插入标准服务器或单独使用

板载GPS/BD模块,也支持IRIG-B码时统输入

供电充足(VU13P核电源150A,47DR核电源50A),满足满负荷FPGA程序运行

一体化散热器,支持加固、三防处理

主要技术参数:

FPGA: XCVU9P、XCVU13P可选配

FPGA外挂3组DDR4,分别80bit、80bit和32bit

ZYNQ的PS外挂1组DDR4,位宽64bit

两个FMC+扩展连接器,全互联了LA[33:0]和GTY[15:0]

支持GPS/BD授时和定位、IRIG-B码接口

QSFP-DD光纤接口,支持UDP/IP、TCP/IP、RapidIO、Aurora协议,速率≥25Gbps

温度监控:可以检测PCB板、环境或散热片温度

电压监控:FPGA自带电压监控功能

LED灯:电源指示灯1颗,状态指示灯4颗

PCIe3.0×16:金手指

PCIe4.0×8:MICO接口,支持PCIe、SATA、NVME等互联

QSFP+_DD接口:支持8路10G以太网、2路40G以太网、2路100G以太网、1路200G以太网,同时也支持UDP/TCP、RapidIO、Aurora协议

GPIO口:16路,分2组,分别为12路和4路,支持3.3V电平,速率最高40MHz

RS232口:2路标准RS232电平,速率最高120Kbps

RS485口:2路半双工,速率最高12Mbps,兼容RS422电平

千兆网口:1路,RJ45连接器, 支持10M/100M/1000M BASE-T

外时钟接口:SMA,到PLL的参考时钟输入

外接电源口:直流+12V,

输出电源:支持输出(500mA电流)+12V或+3.3V供外接天线使用

PCB板尺寸:111.15mm×246mm×2 slot

DC +12V(±5%),功耗45W~145W(根据FPGA的频率和使用资源消耗)

工作温度:-20~+45℃、-40~+60℃可选

FPGA的所有管脚已例化

FPGA读写DDR4、RS232/485/GPIO接口回环、PCIe接口识别到卡、获取板卡温度、接收GPS/BD模块数据、千兆以太网络PHY与计算机联通、光纤接口测试、LED跑马灯等

ADC采数案例、DAC发数案例

模块用户手册(含硬件及软件说明、模块结构及散热注意说明)

产品出货:模块1张(带FPGA散热片)、配套连接器(不带线),不含光模块,保修卡1份(FPGA为易损件不保修)

合格证、测试报告


审核编辑 黄宇

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