用3.3V单片机控制AD7760做信号采集,AD7760的接口电路是2.5V,能不能直接兼容?
用3.3V单片机控制AD7760做信号采集,AD7760的接口电路是2.5V。 请问能不能直接兼容,如不能需要做怎么样的处理?谢谢。
hgimtk 2023-12-20 08:31:54
AD7760的主时钟输入是用晶振还是FPGA产生的脉冲?
以下问题:(三个AD7760同步采集信号) 1、AD7760的主时钟输入是用晶振还是FPGA产生的脉冲,(目前,我们用FPGA产生的时钟) 2、每个AD7760的主时钟共用一个缓冲器
世态薄凉 2023-12-15 07:37:21
AD7760的引脚偏置电压不对是为什么?
我的一块板子上有3片AD7760,参考电压用了3片独立的ADR434,4.096V,根据手册来说,如果参考源是4.096V,那么17号引脚下拉一个160K的偏置电阻到地,以便使得偏置电流为25uA
BILL张 2023-12-14 08:24:04
EVAD7760 AD7760 评估板
EVAL-AD7760EDZ是用于AD7760和AD7762的全功能评估套件。该评估板能够以独立模式工作,或者与EVAL-CED1Z转换器评估和开发板配合使用。与转换器评估和开发板配合使用时,用户
资料下载 zhongnian 2021-05-28 15:53:22
AD7760:24位、2.5 MSPS、100 dB,Σ-Δ ADC,内置片内缓冲 数据手册
AD7760:24位、2.5 MSPS、100 dB,Σ-Δ ADC,内置片内缓冲 数据手册
资料下载 叹久 2021-03-20 17:19:15
ad7760是一种高性能24位模数转换器
The AD7760 is a high performance, 24-bit Σ-Δ analog-to-digital converter (ADC)。 It combines wide
资料下载 2017-09-30 16:04:24
AD7760的差分输入范围与手册不对应是什么原因?
AD7760基准用的是4.096V。但实际测试的差分输入正弦信号峰峰值最大可达2*Vref/0.8,10V多了,数据才达到满量程。请教下这是什么原因?
双11 2023-12-14 07:07:39
AD7760切换采样率不成功是什么原因造成的?
AD7760故障描述: 电路采用4片AD7760,共用SYNC、Reset管脚,MCLK由FPGA(四路共用)输出,经过四路时钟缓冲电路后连到四路7760管脚。4片AD7760数据线不共用,采用非
testd27 2023-12-08 08:24:21
AD7760的并行IO接口和控制IO接口能不能与MCU的IO直接连接呢?
请问一下AD7760的并行IO接口和控制IO接口能不能与MCU的IO直接连接呢?MCU的IO电平是3.3V。AD7760看了是差分信号输入,有没有大神做过单端输入呢?误差这方面怎样呢?能不能达到0.001%呢?
双11 2023-12-08 07:06:54
读取ad7760寄存器数据不稳定怎么解决?
使用ad7760通过电平转换芯片TXS0108E与mcu进行连接,初始化结束后读取超量程寄存器中的数值,结果如下:默认值应该为0xcccc,为什么会不稳定呢,读取函数为 未签名的短短
呜哇哇66 2023-12-08 06:40:07
使用stm32单片机的fsmc经过分压网络连接到ad7760模块,为什么读取出来的是刚刚写入的地址值呢?
使用stm32单片机的fsmc经过分压网络连接到官网ad7760模块,进行数据读取,为什么读取出来的是刚刚写入的地址值呢? [/td]u16 w,regl = 0; AD7760
胡扯123 2023-12-08 06:32:58
AD7760评估板的差分输入信号如何产生?
买的AD7760的开发板,上面只提供差分输入信号接口,而信号发生器只能产生单端信号,难道我自己要去做一个单端转差分的电路,产生差分信号,那这样开发板的意义又何在?
andyfly7 2023-12-07 08:04:51
AD7760采集的数据偏低如何解决?
我使用了AD7760官方开发板和FPGA进行数据采集,上电时对寄存器0x2配置了0x2,寄存器0x1配置了0x18,采集到的数据偏低,例如我使用信号源发了500mV直流信号,但采集到对信号利用公式
ChristineGu 2023-12-05 07:04:05
AD7760评估板配套FPGA开发板无法正常使用的原因?
1.AD7760评估板上电后实测电压与标准电压有偏差,是否会影响后续测量 2.FPGA开发板(EVAL-CED1Z)是否固化了AD7760程序 3.在开发板上下载了官网附带的AD7760程序并安装
费加罗 2023-12-04 06:06:01
AD7760初始化以后drdy信号一直为高电平是为什么?
有没有碰到AD7760初始化以后,drdy信号一直为高电平的,请大神来解答一下
jf_11513021 2021-03-09 21:48:02
AD7760官方套件测试问题
`购买了AD7760官方评估板AD7760EVAL及FPGA板EVAL-CED1Z,测试过程中,官方上位机无数据显示,其中AD7760的MCLK正常输出约为40MHz,DRDY正常输出,并且在通过
晓风残月5536 2020-11-25 15:02:29
AD7760切换采样率不成功
AD7760故障描述: 电路采用4片AD7760,共用SYNC、Reset管脚,MCLK由FPGA(四路共用)输出, 经过四路时钟缓冲电路后连到四路7760管脚。4片AD7760数据线不共用
jackyzhangjian 2019-01-29 13:52:28
AD7760的差分输入范围与手册不对应
AD7760基准用的是4.096V。但实际测试的差分输入正弦信号峰峰值最大可达2*Vref/0.8,10V多了,数据才达到满量程。请教下这是什么原因?
看服务淡口味 2019-01-09 11:09:21
AD7760的DRDY一直为高电平怎么解决?
情况:用FPGA(IO电压3.3V)直接控制AD7760(没有加驱动类的芯片),现在测试DRDY一直为高电平,不知道是什么问题?
chengzheng123 2018-09-05 19:12:21
关于AD7760三路同步采集的主时钟和供电电源问题
以下问题:(三个AD7760同步采集信号)1、AD7760的主时钟输入是用晶振还是FPGA产生的脉冲,(目前,我们用FPGA产生的时钟)2、每个AD7760的主时钟共用一个缓冲器(SN7S08
uvysdfydad 2018-09-03 14:03:25
请问AD7760两种数据输出模式:调制器下为何只有16位?
AD7760两种数据输出模式:调制器下为何只有16位?输入与输出对应的关系是什么?
gzjiuwang 2018-08-17 08:01:12
AD7760采样 波形如图,请问为什么会出现这种现象?
使用AD7760芯片,采集100hz,峰峰值1v的正弦信号,波形如下:为何会出现这种现象?
gzjiuwang 2018-08-08 09:42:52
关于AD7760性能指标的问题
AD7760是24位AD转换器,根据datasheet中 结合 可以算出AD7760的实际性能:78khz大概有18位多,2.5MHZ大概有16位多,请问1、这么算是否正确?什么情况下可以做到真正的24位?
gzjiuwang 2018-08-06 09:23:03
请问AD7760的并行IO接口和控制IO接口能不能与MCU的IO直接连接呢?
请问一下AD7760的并行IO接口和控制IO接口能不能与MCU的IO直接连接呢?MCU的IO电平是3.3V。AD7760看了是差分信号输入,有没有大神做过单端输入呢?误差这方面怎样呢?能不能达到0.001%呢?
fhj920535793 2018-07-31 12:42:55
请问读取ad7760寄存器数据不稳定怎么解决?
使用ad7760通过电平转换芯片TXS0108E与mcu进行连接,初始化结束后读取超量程寄存器中的数值,结果如下:默认值应该为0xcccc,为什么会不稳定呢,读取函数为unsigned short
wang21cj 2018-07-30 10:08:15
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