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Versal 产品组合基于 台积电(TSMC)的 7 nm FinFET 工艺技术,是第一个将软件可编程性与特定领域硬件加速和灵活应变能力相结合的平台,这对于跟上当今快速的创新步伐至关重要。
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Versal自适应SoC让Combo PON方案高性能、易于使用
通信服务提供商往往采用无源光网 (PON) 为最终用户带来高速和低成本的光纤接入。它们通常作为在最后一英里将互联网和云连接到家庭和企业的纽带。过去几年里...
Versal ACAP,APU - 跟踪系统中发生 ATB 停滞可能引发处理器死锁
处理器可使用等待事件 (wait for event, WFE) 或等待中断 (wait for interrupt, WFI) 机制来进入低功耗状态。...
Versal ACAP、APU - DSB 指令后可能会发生推测性 TLB 填充
Arm 发行的白皮书 "Cache Speculation Side-channels"用于发现 "Spectre&quo...
Versal ACAP,APU - 由于旧负载检测到异步外部异常中止,导致新负载误报同步外部异常中止
在某些条件下,新负载如果复用旧器件负载的分组标识 (GID),则可能报告同步外部异常中止,原因是错误关联旧器件存储器访问所检测到的外部错误。器件负载快速...
Versal ACAP PS GEM - GEM 控制器可能在大型发送卸载配置中触发错误的 Amba_Error
当在硬件配置中包含“大型发送卸载 (Large Send Offload)”并在缓冲区描述符中启用 LSO 功能时,GEM IP 可能通过中断状态寄存器...
Versal ACAP, RPU - 为调试寄存器 DBGDSAR 设置的值错误
每个 RPU 处理器都有 1 个 DBGDSAR 寄存器,其中包含其 CoreSight ROM 表的偏移地址。但是,读取 RPU 的 DBGDSAR ...
Versal ACAP、APU - ELR 错误报告序列中加密指令之间的中断
在 aarch32 模式下,如果执行的代码包含下面的加密指令序列,并且在执行第一条加密指令后立即断言并中断,ELR 会被记录为返回地址,产生的错误可能会...
Versal ACAP,APU - 当有逐出传输事务处于暂挂状态时,外部数据嗅探可能导致数据损坏
如果 Arm Cortex-A72 处理器配置为向处于 UniqueClean (UC) 状态的缓存行发送逐出传输事务,那么 Cortex-A72 处理...
Vitis 环境开发方法论反应了 Versal ACAP 系统的异构性质,此类系统通常是由 PS、PL 和 AI 引擎功能组成的。您可使用 Vitis ...
Versal与MPSoC在cache维护数据的架构上,有一定的相似性。所以在Versal器件里,我们仍然可以使用上述文档 [1] 里8.1和8.2的ch...
Versal 自适应计算加速平台 (ACAP) 将标量引擎 (Scalar Engine)、自适应引擎 (Adaptable Engine) 和智能引擎...
Xilinx宣布7nm Versal AI Core和Versal Prime系列器件全面量产出货
Versal AI Core 系列提供了 Versal 产品组合中的最高算力和最低时延,借助其 AI 引擎实现了突破性的 AI 推断吞吐量和性能。
在瞬息万变的智能化时代, 单一计算架构已难以应对处理海量数据的重任, 业界亟需“异构计算”来解决当今所面临的挑战, 赛灵思 Versal ACAP, 作...
VMK180 评估套件支持 Versal Prime 系列 VM1802 器件,该器件集软件可编程芯片基础架构与世界级计算引擎以及一系列连接选项为一体,...
Xilinx的28nm、16nm SoC在业界应用非常广泛。最近也发布了7nm的SoC器件Versal VC1902和对应的开发板VCK190。Vers...
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