电子发烧友App

硬声App

0
  • 聊天消息
  • 系统消息
  • 评论与回复
登录后你可以
  • 下载海量资料
  • 学习在线课程
  • 观看技术视频
  • 写文章/发帖/加入社区
创作中心

完善资料让更多小伙伴认识你,还能领取20积分哦,立即完善>

3天内不再提示
电子发烧友网>电子资料下载>电子资料>FPGA配置原理资料下载

FPGA配置原理资料下载

2021-04-20 | pdf | 261.86KB | 次下载 | 免费

资料介绍

  摘 要:近年来,随着FPGA电路在军工和航天领域的广泛应用,用户对FPGA 电路的可靠性要求也越来越高。在的可靠性*估试验中,动态老化试验是最重要的试验之一,FPGA 动态老化技术的实现可以提高FPGA 电路的可靠性。文章通过研究FPGA 电路内部结构和功能模块,讨论FPGA 电路加载配置过程的原理和流程,通过对动态老化和静态老化的对比试验和结果分析,研究出FPGA 电路动态老化试验方法,并在工程实践中得到了成功实现和应用。     1 引言     FPGA 是现场可编程门阵列(Field ProgrammingGate Array)的缩写,用户可以编写程序对FPGA 内部的逻辑模块和I/O 模块重新配置,以实现芯片的逻辑功能。近年来,FPGA芯片以其大规模、高集成度、高可靠性、投资少、保密性好、开发方便、使用灵活、可在线编程等优点得到了广泛的应用。随着FPGA 电路在军工和航空航天领域的应用,其高可靠性尤为重要,为了提高电路的可靠性,最好的方法是对电路进行筛选,其中老化试验就是筛选过程中最为重要的环节之一。   考虑到FPGA 电路的工作模式比较复杂,外部需要存储器或者FLASH 对其进行配置,FPGA 才能动态工作,因此国内一般的FPGA 老化技术都采用了静态老化试验方法。这种静态老化试验方法存在着一定的缺陷,电路在老化过程中并没有受到真正的应力,因此并不能真正剔除掉早期失效的产品,其可靠性得不到保证。对FPGA 电路动态老化的研究,提高老化试验条件的严酷度,即可保证电路的高可靠性要求。     2 动态老化试验     集成电路的动态老化理论上要求电路在其最高温度工作条件下完全模拟实际工作状态,电路内部的逻辑单元都有机会得到翻转,对于一般数字集成电路都需要外部提供功能测试码来工作。   对于FPGA 电路的动态老化试验来说,功能测试码是存储在外部存储器中的配置程序,将程序配置到FPGA 电路内部,使内部的门阵列全部工作起来,实现高覆盖率的逻辑节点的翻转,让其按照规定的功能工作。因此本研究工作的关键在如何进行FPGA电路的程序配置。     3 FPGA设计流程     完整的FPGA 设计流程包括逻辑输入、功能仿真、综合及时序分析、实现、加载配置、调试。FPGA 配置就是将特定的应用程序设计按FPGA设计流程转化为数据位流加载到FPGA 的内部存储器中,实现特定逻辑功能的过程。由于FPGA 电路的内部存储器都是基于RAM 工艺的,所以当FPGA电路电源掉电后,内部存储器中已加载的位流数据将随之丢失。所以,通常将设计完成的FPGA 位流数据存于外部存储器中,每次上电自动进行FPGA电路配置加载。     4 FPGA配置原理     以Xilinx公司的Qpro Virtex Hi-Rel系列XQV100电路为例,FPGA的配置模式有四种方案可选择:MasterSerial Mode,Slave Serial Mode,Master selectMAPMode,Slave selectMAP Mode。配置是通过芯片上的一组专/ 复用引脚信号完成的,主要配置功能信号如下:   (1)M0、M1、M2:下载配置模式选择;   (2)CLK:配置时钟信号;   (3)DONE:显示配置状态、控制器件启动;   (4)PROG_B:初始化引出端;   (5)INT_B:配置延迟控制,配置错误显示;   (6)DOUT:菊花链中的配置数据输出。   (7)DIN:串行数据输入;   FPGA 电路在选定模式下的配置过程包括四个主要阶段:   (1)清除FPGA 电路内部配置存储器;   (2)初始化FPGA 电路配置逻辑功能;   (3)加载FPGA 电路配置数据流;   (4)FPGA 电路配置完成,启动电路就绪序列。   主串模式电路连接图见图1。        图1 FPGA 配置主串模式连接图     系统或芯片上电后,信号引脚PROG_B被拉低,FPGA的配置RAM存储器清空;同样,PROG_B上的逻辑低电平将会复位配置逻辑,并使FPGA 保持在清空配置存储器状态。只要PROG_B 引脚保持低电平,则FPGA 将继续清空它的配置RAM存储器,并使INIT_B 信号保持为低电平以表明配置在被清空。   当PROG_B被释放时,FPGA将继续使INIT_B保持低电平,直到完成清空所有的配置存储器。FPGA 在INIT_B信号的上升沿检测其模式引脚M0、M1、M2。   INIT_B 信号变为高电平后,配置就可以开始了,不需要额外的暂停或等待周期。但是,配置过程不必在INIT_B 变化之后就立即开始。配置逻辑只有当位流的同步字被载入时才开始处理数据。当上电清除配置RAM存储器后,INIT_B信号引脚变高电平,可以开始载入配置数据:标准的位流首先是引入空闲字FFFFFFFFh,其次是同步字AA995566h,然后是一些配置控制信息,紧跟其后的才是真正的位流数据帧和相关的CRC;位流的最后是CRC 校验和启动芯片进入工作态。FPGA 电路配置流程图如图2 所示。        图2 FPGA 电路配置流程图  
下载该资料的人也在下载 下载该资料的人还在阅读
更多 >

评论

查看更多

下载排行

本周

  1. 1山景DSP芯片AP8248A2数据手册
  2. 1.06 MB  |  532次下载  |  免费
  3. 2RK3399完整板原理图(支持平板,盒子VR)
  4. 3.28 MB  |  339次下载  |  免费
  5. 3TC358743XBG评估板参考手册
  6. 1.36 MB  |  330次下载  |  免费
  7. 4DFM软件使用教程
  8. 0.84 MB  |  295次下载  |  免费
  9. 5元宇宙深度解析—未来的未来-风口还是泡沫
  10. 6.40 MB  |  227次下载  |  免费
  11. 6迪文DGUS开发指南
  12. 31.67 MB  |  194次下载  |  免费
  13. 7元宇宙底层硬件系列报告
  14. 13.42 MB  |  182次下载  |  免费
  15. 8FP5207XR-G1中文应用手册
  16. 1.09 MB  |  178次下载  |  免费

本月

  1. 1OrCAD10.5下载OrCAD10.5中文版软件
  2. 0.00 MB  |  234315次下载  |  免费
  3. 2555集成电路应用800例(新编版)
  4. 0.00 MB  |  33566次下载  |  免费
  5. 3接口电路图大全
  6. 未知  |  30323次下载  |  免费
  7. 4开关电源设计实例指南
  8. 未知  |  21549次下载  |  免费
  9. 5电气工程师手册免费下载(新编第二版pdf电子书)
  10. 0.00 MB  |  15349次下载  |  免费
  11. 6数字电路基础pdf(下载)
  12. 未知  |  13750次下载  |  免费
  13. 7电子制作实例集锦 下载
  14. 未知  |  8113次下载  |  免费
  15. 8《LED驱动电路设计》 温德尔著
  16. 0.00 MB  |  6656次下载  |  免费

总榜

  1. 1matlab软件下载入口
  2. 未知  |  935054次下载  |  免费
  3. 2protel99se软件下载(可英文版转中文版)
  4. 78.1 MB  |  537798次下载  |  免费
  5. 3MATLAB 7.1 下载 (含软件介绍)
  6. 未知  |  420027次下载  |  免费
  7. 4OrCAD10.5下载OrCAD10.5中文版软件
  8. 0.00 MB  |  234315次下载  |  免费
  9. 5Altium DXP2002下载入口
  10. 未知  |  233046次下载  |  免费
  11. 6电路仿真软件multisim 10.0免费下载
  12. 340992  |  191187次下载  |  免费
  13. 7十天学会AVR单片机与C语言视频教程 下载
  14. 158M  |  183279次下载  |  免费
  15. 8proe5.0野火版下载(中文版免费下载)
  16. 未知  |  138040次下载  |  免费