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如果你发现，以前低速时代积累的设计经验现在似乎都不灵了，同样的设计，以前没问题，可是现在却无法工作，那么恭喜你，你碰到了硬件设计中最核心的问题： 信号完整性 。早一天遇到，对你来说是好事。在过去的低速时代，电平跳变时信号上升时间较长，通常几个 ns。器件间的互连线不至于影响电路的功能，没必要关心信号完整性问题。 但在今天的高速时代， 随着 IC 输出开关速度的提高， 很多都在皮秒级，不管信号周期如何， 几乎所有设计都遇到了信号完整性问题。 另外，对低功耗追求使得内核电压越来越低， 1.2v 内核电压已经很常见了。因此系统能容忍的噪声余量越来越小，这也使得信号完整性问题更加突出。广义上讲， 信号完整性 是指在电路设计中互连线引起的所有问题，它主要研究互连线的电气特性参数与数字信号的电压电流波形相互作用后，如何影响到产品性能的问题。主要表现在对时序的影响、信号振铃、信号反射、近端串扰、远端串扰、开关噪声、非单调性、地弹、电源反弹、衰减、容性负载、电磁辐射、电磁干扰等。信号完整性 问题的根源在于信号上升时间的减小。即使布线拓扑结构没有变化，如果采用了信号上升时间很小的 IC 芯片，现有设计也将处于临界状态或者停止工作。下面谈谈几种常见的信号完整性问题。反射 ：图 1 显示了信号反射引起的波形畸变。看起来就像振铃，拿出你制作的电路板，测一测各种信号，比如时钟输出或是高速数据线输出，看看是不是存在这种波形。如果有，那么你该对信号完整性问题有个感性的认识了，对，这就是一种信号完整性问题。
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