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介绍了一种基于FPGA的多路同步、实时数据采集新方案，着重对其硬件结构和控制逻辑进行了阐述，并从工程实践方面给出了电路的实现原则。该方案控制方式灵活可变、具有一定的扩展性和通用性，已被成功地应用于双模信息融合系统的设计中，实现了对雷达导引头的多信号实时同步采集。
在雷达／红外双模导引头的信息融合系统中，需要对雷达导引头的多个模拟信号进行实时数据采集，同时还要保证相关数据的同步性。传统的方案有以下两种：①采用多片ADC器件，每路模拟输人对应1片ADC，由系统软、硬件控制各ADC同步工作（如图1（a）所示）；②采用1片高速ADC器件，各模拟输入信号分别经同步采样和保持后，由多路开关选择后送给ADC，由系统软、硬件控制多路开关切换，使ADC依次完成各路数据的采集（如图1（b）所示）。由于双模信息融合系统中需要采集的模拟信号共有15路，且每5路相关，采用上述两种方案均存在一定的缺陷。方案①可以满足系统的实时性和同步性要求，但需采用15片ADC器件，相应的外围电路庞大，接口复杂，要占用较大的电路板空间，无法满足系统的小型化要求，同时硬件成本也很高；方案②的ADC接口和外围电路简单，可满足系统的小型化要求，但是对相关数据的采集非真实同步，且实时性对多路开关和ADC提出了较高的要求。当系统分辨率为14 bit时，要在5¨s内完成5路相关数据的采集，ADC的采样率必须高达1 MS／S，而这样高速高分辨率的ADC在市场上是很难找到的。针对这一问题，提出了一种基于FPGA的多路同步、实时数据采集的新方案。
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