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FPGA怎么搭复位电路 fpga复位电路设计方案

2018年08月08日 15:14 次阅读

FPGA和复位电路相比大家应该都比较熟悉,那么对于FPGA怎么搭复位电路你知道吗?本文介绍的就是关于FPGA怎么搭复位电路以及fpga复位电路设计方案。

复位电路

为确保微机系统中电路稳定可靠工作,复位电路是必不可少的一部分,复位电路的第一功能是上电复位。一般微机电路正常工作需要供电电源为5V±5%,即4.75~5.25V。由于微机电路是时序数字电路,它需要稳定的时钟信号,因此在电源上电时,只有当VCC超过4.75V低于5.25V以及晶体振荡器稳定工作时,复位信号才会撤除,微机电路开始正常工作。

复位电路,就是利用它把电路恢复到起始状态。就像计算器的清零按钮的作用一样,以便回到原始状态,重新进行计算。和计算器清零按钮有所不同的是,复位电路启动的手段有所不同。一是在给电路通电时马上进行复位操作;二是在必要时可以由手动操作;三是根据程序或者电路运行的需要自动地进行。复位电路都是比较简单的大都是只有电阻和电容组合就可以办到了。再复杂点就有三极管等等配合程序来进行了。

FPGA

FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。

FPGA怎么搭复位电路 fpga复位电路设计方案

系统设计师可以根据需要通过可编辑的连接把FPGA内部的逻辑块连接起来,就好像一个电路试验板被放在了一个芯片里。一个出厂后的成品FPGA的逻辑块和连接可以按照设计者而改变,所以FPGA可以完成所需要的逻辑功能。

FPGA一般来说比ASIC(专用集成电路)的速度要慢,实现同样的功能比ASIC电路面积要大。但是他们也有很多的优点比如可以快速成品,可以被修改来改正程序中的错误和更便宜的造价。厂商也可能会提供便宜的但是编辑能力差的FPGA。因为这些芯片有比较差的可编辑能力,所以这些设计的开发是在普通的FPGA上完成的,然后将设计转移到一个类似于ASIC的芯片上。另外一种方法是用CPLD(Complex Programmable Logic Device,复杂可编程逻辑器件)。

FPGA怎么搭复位电路

异步复位:复位信号和系统时钟信号的触发可以在任何时刻。二者相互独立。 

同步复位:在系统时钟信号的触发下,复位信号有效。 

verilog表示会更明显:

// 异步复位

reg a;

always @ (posedge clk or negedge rst_n) begin

if(!rst_n)

a <= 'd0;

else

a <= ~a;

end

//同步复位

reg b;

always @ (posedge clk)  begin

if(!rst_n)

b <= 'd0;

else    

b <= ~b;

end

如果复位信号的撤销发生在系统时钟的建立和保持时间这段时间内,系统此时检测到复位信号的状态就处在一个亚稳态,无法确定是0还是1。就有可能造成系统工作不同步的问题。

异步复位会影响寄存器的recovery时间,引起设计的稳定性问题,尤其对于状态机的无意识复位,将导致进入不确定的状态。 

同步复位最主要的问题是对于不带同步复位专用端口的器件会增加额外的逻辑资源。 

//异步复位、同步释放

reg rst_nr1;

reg rst_nr2;

always @ (posedge clk or negedge rst_n) begin

if(!rst_n)

rst_nr1 <= 'd0;

else

rst_nr1 <= 1'b1;

end

always @ (posedge clk or negedge rst_n) begin

if(!rst_n)

rst_nr2 <= 'd0;

else

rst_nr2 <= rst_nr1;

end

简单分析一下这个电路,当异步复位发生,rst_nr2直接拉低为0,并且由于rst_nr2是在时钟沿的作用下对rst_nr1进行采样,所以当rst_nr2的置1是和时钟沿同步的。也就是异步复位、同步释放。然后用信号rst_nr2作为系统复位时钟,就不发生亚稳态现象。

但是在我的理解看来,这两个触发器仍然是采用rst_n作为复位信号,所以必然会有亚稳态的现象发生,即rst_nr2还是 有可能在不应该复位的时间点复位,但是由rst_nr2作为系统复位信号的后级电路不会发生系统工作不同步的现象。

fpga复位电路设计方案

对FPGA设计中常用的复位设计方法进行了分类、分析和比较。针对FPGA在复位过程中存在不可靠复位的现象,提出了提高复位设计可靠性的4种方法,包括清除复位信号上的毛刺、异步复位同步释放、采用专用全局异步复位/置位资源和采用内部复位。上述方法可有效提高FPGA复位的可靠性。
 

对FPGA芯片而言,在给芯片加电工作前,芯片内部各个节点电位的变化情况均不确定、不可控,而这种不确定且不可控的情况会使芯片在上电后的工作状态出现错误。因此,在FPGA的设计中,为保证系统能可靠进进入工作状态,以及避免对FPGA输出关联的系统产生不良影响,FPGA上电后要进行复位,且为了消除电源开关过程中引起的抖动影响,复位信号需在电源稳定后经过一定的延时才能撤销,FPGA的复位信号需保证正确、稳定、可靠。

在FPGA的设计中,多数情况下复位电路的功能虽能够正常完成,但电路并未得到精确合理的设计,仍存在可靠性设计缺陷。为确保系统复位的可靠性,有必要对FPGA复位的可靠性设计方法进行研究。

1 复位设计方法分类

复位的目的是在仿真时将设计强制定位在一个可知状态,合理选择复位方式是电路设计的关键。根据与系统时钟域的关系,复位电路可分为同步复位和异步复位。同步复位是指复位信号只在时钟沿到来时,才有效。否则,无法完成对系统的复位工作。异步复位是指无论时钟沿是否到来,只要复位信号有效,使对系统进行复位。

根据是否存在外部复位端口,复位电路又可分为外部复位和内部复位。外部复位是指复位信号主要来自外部引脚的输入,如复位按钮、电源模块输出等。内部复位信号则是主要由FPGA内部电路产生。

2 复位设计方法的比较

2.1 同步复位与异步复位

2.2.1 同步复位

指定同步复位时,always的敏感表中仅有一个时钟沿信号,只有当时钟沿采集到同步复位的有效电平时,才会在时钟沿到达时刻进行复位操作。若目标器件或可用库中的触发器本身包含同步复位端口,则在实现同步复位电路时可直接调用同步复位端。然而多数目标器件的触发器本身并不包含同步复位端口,需使复位信号与输入信号组成某种组合逻辑,然后将其输入到寄存器的输入端。为了提高复位电路的优先级,通常在电路描述时使用带有优先级的if…else结构,复位电路在第一个if下描述,其他电路在else或else…if分支中描述。复位电路综合后的RTL图如图1所示。

FPGA怎么搭复位电路 fpga复位电路设计方案

同步复位电路图

根据同步电路的特点,其电路优点有:(1)同步复位有利于基于周期机制的仿真器进行仿真。(2)使用同步复位可设计100%的同步时序电路,有利于时序分析,其综合结果的频率较高。(3)同步复位仅在时钟的有效沿生效,可有效避免因毛刺造成的亚稳态和错误。毛刺信号是由FPGA内部结构特征决定的,同步复位在进行复位和释放复位信号时,仅当时钟沿采到复位信号电平变化时进行相关操作,若复位信号树的组合逻辑出现了某种毛刺,此时时钟沿采到毛刺的概率较低,由此通过时钟沿采样,可有效过波复位电路组合逻辑产生的毛刺,增强了电路稳定性。

同步复位的缺点有:(1)多数目标器件库的触发器本身并不包含同步复位端口,使用同步复位会增加更多逻辑资源。(2)同步复位的最大问题在于必须保证复位信号的有效时间,需要一个脉宽延展器以确保复位信号有一定脉冲宽度,由此才能保证所有触发器均能有效复位。由于同步复位仅当时钟沿采到复位信号时才会进行复位操作,所以其信号的持续时间要大于设计的最长时钟周期,以保证所有时钟的有效沿都能采样到同步复位信号。事实上,仅保证同步复位信号的持续时间大于最慢的时钟周期是不够的,设计中还需考虑到同步复位信号树通过所有相关组合逻辑路径时的延时,以及由于时钟布线产生的偏斜。只有同步复位大于时钟最大周期,加上同步信号穿过的组合逻辑路径延时和时钟偏斜延时,才能确保同步复位的可靠。

2.2.2 异步复位

指定异步复位时,只需在always的敏感表中加人复位信号的有效沿即可,当复位信号有效沿到达时,无论时钟沿是否有效,复位均会立即发挥其功能。

大多数目标器件和ASIC库的触发器均包含异步复位端口,异步复位会直接接人触发器的异步复位端口,综合后的RTL图如图2所示。

FPGA怎么搭复位电路 fpga复位电路设计方案

异步复位电路图

根据异步电路的特点,异步复位的优点有:(1)由于多数目标器件库的触发器都包含异步复位端口,异步复位会节约逻辑资源。(2)异步复位设计简单。(3)对于多数FPGA,均有专用的全局异步复位/置位资源(GSR,Global Set Reset),还可使用GSR资源,异步复位到达所有寄存器的偏斜最小。  异步复位的缺点如下:(1)异步复位的作用和释放与时钟沿并无直接关系,异步复位生效时问题并不明显;但当释放异步复位时,若异步复位信号释放时间和时钟的有效沿到达时间几乎一致,则容易造成触发器输出为亚稳态,形成逻辑错误。(2)若异步复位逻辑树的组合逻辑产生了毛刺,则毛刺的有效沿会使触发器误复位,造成逻辑错误。

2.3 外部复位和内部复位

外部复位,复位信号主要来自外部引脚的输人。复位信号在电路板上可能会受到来自其他线路的串扰,因此可能产生毛刺,在无需复位系统时,毛刺信号可能导致系统误复位。

内部复位,FPGA上电配置完成后,由FPGA内部电路产生复位信号,复位信号与时钟同步。通常内部复位的设计方法是:设计一个初始值为0X0000的SRL16,将其输人接高电平,输出作为复位信号。

3 复位可靠性设计方法

3.1 消除复位信号上的毛刺

在系统设计中,若采用低有效复位信号,可按照图3所示方法对复位信号中的毛刺进行消除。延时器件对数据进行延时的长度决定复位毛刺消除电路所能避免的毛刺长度,而延时器件的延时长度也决定需要提供有效复位信号的最短时间。

如果复位信号高有效,则将图3中的或门改为与门使用。为更好地消除毛刺,可在复位毛刺消除电路后再加上寄存器对复位信号进行时钟同步。在通常复位电路的设计中,毛刺的长度一般情况下>1个时钟周期,<16个时钟周期。为节省资源,延时器件通常选用SRL16。SRL16可设置初始值,但不带复位功能16bit移位寄存器,能够通过A0~A3的4根地在线选择从第几个寄存器输出。通常将其作为一个普通的16bit移位寄存器使用。

3.2 异步复位同步释放

在有些应用中,复位信号需要在时钟尚未给出或不稳定的情况下传到后级,在时钟稳定之后,再撤去复位信号。此时需使用异步复位来实现。由于异步复位时,时钟和复位关系的不确定性,易造成触发器输出亚稳态,引起逻辑错误。为确保其复位的可靠性,通常采用异步复位,同步释放的方式。

所谓异步复位,同步释放就是在复位信号到达时不受时钟信号的同步,而是在该信号释放时受时钟信号的同步。通过一个复位信号综合器便可实现异步复位,同步释放。综合后的RTL图如图3所示,其仿真结果表明该电路能有效的实现复位及脱离复位。

FPGA怎么搭复位电路 fpga复位电路设计方案

异步复位、同步释放电路图
 

3.3 采用专用全局异步复位/置位资源

全局异步复位/置位资源的主要作用是对系统中存在的所有触发器、锁存器、查找表单元的输出寄存器进行复位,不会占有额外的布线资源。使用GSR资源,异步复位到达所有寄存器的偏斜最小。

3.4 采用内部复位的设计方法

在无需复位信号先于时钟信号产生的应用中,为避免外部复位毛刺的影响、异步复位电路可能引起的亚稳态以及减少资源的使用率,可通过FPGA产生内部复位,然后采用异步的方式对其的内寄存器进行复位。由于该复位信号由FPGA内部产生,不会因外部干扰而产生毛刺,同时又与时钟同步,不存在因异步复位导致的亚稳态现象,因此可确保系统可靠复位。

结语

FPGA的可靠复位是保证系统能够正常工作的必要条件,本文对FPGA设计中常用的复位设计方法进行了分类、分析和比较,并针对各种复位方式的特点,提出了如何提高复位设计可靠性的方法。在工程实践中,上述方法可以有效减少或消除FPGA复位所产生的错误。

关于FPGA复位电路的介绍就到这里了,希望通过本文能让你对FPGA复位电路的整体架构有更深的理解,如有不足之处欢迎指正。

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51单片机复位电路原理是什么?为什么为复位?

RIO技术之快速设计自定义硬件

借助可重新设置FPGA芯片和LabVIEW图形化开发工具,NI可重新设置I/O(RIO)技术可用于自...

发表于 2018-07-29 11:02 230次阅读
RIO技术之快速设计自定义硬件

FPGA究竟是什么?真的能代替CPU架构吗?

你还没听过FPGA?那你一定是好久没有更新自己在企业级IT领域的知识了。今天笔者就和大家聊聊何为FP...

发表于 2018-07-28 11:26 376次阅读
FPGA究竟是什么?真的能代替CPU架构吗?

关于FPGA的设计与应用知识详解

FPGA(Field-Program mable Gate Array),即现场可编程门阵列,它是在...

发表于 2018-07-28 11:08 120次阅读
关于FPGA的设计与应用知识详解

FPGA和STM32的区别是什么 stm32与f...

FPGA中的基本逻辑单元是CLB模块,一个CLB模块一般包含若干个基本的查找表、寄存器和多路选择器资...

发表于 2018-07-28 09:58 162次阅读
FPGA和STM32的区别是什么 stm32与f...

基于FPGA和STM32的FSMC通信

FSMC简介:FSMC即灵活的静态存储控制器,FSMC管理1GB空间,拥有4个Bank连接外部存储器...

发表于 2018-07-28 09:35 78次阅读
基于FPGA和STM32的FSMC通信

简谈FPGA中系统运行频率计算方法与组合逻辑的层...

大家好,又到了每日学习的时间了,最近一个月比较忙,没有更新文章,希望各位没有想我,哈哈。 无用的话不...

发表于 2018-07-27 19:16 551次阅读
简谈FPGA中系统运行频率计算方法与组合逻辑的层...

可广泛应用于高密度深度学习片上系统(SoC)、F...

MAX77714 PMIC提供完备、高效、小尺寸电源管理方案,支持多核处理器系统工作在最高性能,在3...

发表于 2018-07-27 14:31 358次阅读
可广泛应用于高密度深度学习片上系统(SoC)、F...

阿里FPGA云服务器平台FaaS,可大大降低加速...

FPGA (现场可编程门阵列)由于其硬件并行加速能力和可编程特性,在传统通信领域和IC设计领域大放...

发表于 2018-07-27 14:25 113次阅读
阿里FPGA云服务器平台FaaS,可大大降低加速...

首款基于FPGA的原创深度学习语音识别加速解决方...

深鉴科技于国内领先公有云服务商华为云发布语音识别加速引擎DDESE——DeePhi Descart...

发表于 2018-07-27 14:25 94次阅读
首款基于FPGA的原创深度学习语音识别加速解决方...

基于Intel SoC FPGA的光伏电力通信管...

光伏发电站利用大量的光伏电池板完成从光能到直流电能的转换,再将直流电能使用逆变器转换为50 Hz的交...

发表于 2018-07-26 16:04 111次阅读
基于Intel SoC FPGA的光伏电力通信管...

基于带通采样的AIS非相干解调软件接收机的FPG...

AIS系统是一种船舶交通信息交换系统,船载AIS设备不断发送自身信息,如航向、吨位等,用以领航调度、...

发表于 2018-07-26 15:49 73次阅读
基于带通采样的AIS非相干解调软件接收机的FPG...

关于分段多项式近似的DDFS研究及FPGA实现的...

感应式磁力仪基于法拉第电磁感应原理,用于探测近地空间的低频交变磁场 ,它通常自带标准信号源,用于在轨...

发表于 2018-07-26 15:30 81次阅读
关于分段多项式近似的DDFS研究及FPGA实现的...

FPGA是什么?为什么要使用它?

最近几年,FPGA这个概念越来越多地出现。例如,比特币挖矿,就有使用基于FPGA的矿机。还有,之前微...

发表于 2018-07-26 14:41 354次阅读
FPGA是什么?为什么要使用它?

为什么中国AI芯片产业难改依附式生存?

芯片定义了产业链和生态圈的基础计算架构,正如CPU是IT产业的核心一样,芯片也是人工智能产业的核心。...

发表于 2018-07-26 10:01 883次阅读
为什么中国AI芯片产业难改依附式生存?

赛灵思:FPGA的鼻祖,全球最大的FPGA厂商

到目前为止,赛灵思的产品已经在29个OEM品牌的111种车型上得到了应用,未来这个数字还会扩大。

发表于 2018-07-25 08:44 782次阅读
赛灵思:FPGA的鼻祖,全球最大的FPGA厂商

为什么说AI芯片是FPGA的附庸?

央行放水之后,催生出了一大批手握重金的投资机构,而国内优秀的投资标的,特别是高科技领域的标的极为稀缺...

发表于 2018-07-25 08:39 1888次阅读
为什么说AI芯片是FPGA的附庸?

以SoC FPGA为设计平台的北斗卫星信号跟踪算...

全球导航卫星系统(Global Navigation Satellite System,GNSS)...

发表于 2018-07-24 17:43 175次阅读
以SoC FPGA为设计平台的北斗卫星信号跟踪算...

基于块匹配的高斯背景建模-ROI映射方法的FPG...

与H.264/AVC相比,新一代视频压缩标准H.265/HEVC能够在相同的图像质量下实现更低的码...

发表于 2018-07-24 17:28 90次阅读
基于块匹配的高斯背景建模-ROI映射方法的FPG...

FPGA对DC-DC精度的要求不断提升

供电电源的稳态直流精度主要取决于两个因素:电压调整精度和输出电压纹波。这里有一个误区,很多工程师只通...

发表于 2018-07-24 15:05 327次阅读
FPGA对DC-DC精度的要求不断提升

FPGA产品升级进击,赛灵思三大战略助力加速市场...

FPGA领域的玩家多年来都波澜不惊,所以当2015年唯一可称得上直接竞争对手的Altera被英特尔...

发表于 2018-07-23 17:23 62次阅读
FPGA产品升级进击,赛灵思三大战略助力加速市场...

基于FPGA的可调FIR滤波器在实际通信系统中的...

基于灵活自适应的空口波形技术FOFDM(Filtered OFDM)是现代通信技术的研究热点,设...

发表于 2018-07-23 17:21 58次阅读
基于FPGA的可调FIR滤波器在实际通信系统中的...

关于国产FPGA发展现状以及未来发展前景趋势详解

2018年上半年对于中国半导体行业而言是多事之秋,发生了几件让国人深入思考的大事。我作为IC产业的...

发表于 2018-07-23 17:18 291次阅读
关于国产FPGA发展现状以及未来发展前景趋势详解

关于FPGA与深度学习的关系探析详解

人工智能的风潮从技术一路蔓延到硬件,让“芯片”成为今年行业里盛极一时的主题。人们关注通用芯片领域里C...

发表于 2018-07-23 17:12 119次阅读
关于FPGA与深度学习的关系探析详解

当FPGA跟ASIC分界线日益模糊,FPGA还像...

随着处理器被添加到传统FPGA中,可编程性被添加到ASIC中,FPGA和ASIC的分界线日益模糊。

发表于 2018-07-23 17:07 85次阅读
当FPGA跟ASIC分界线日益模糊,FPGA还像...

中国AI芯片产业难改依附式生存现状的原因有哪些?

日前,全球最大的可编程芯片(FPGA)厂商赛灵思宣布收购中国 AI 芯片领域的明星创业公司—深鉴科...

发表于 2018-07-23 16:49 108次阅读
中国AI芯片产业难改依附式生存现状的原因有哪些?

高云半导体小蜜蜂家族再添新成员——GW1NS-2...

中国广州,2018年7月23日,广东高云半导体科技股份有限公司(以下简称“高云半导体”)今日宣布:高...

发表于 2018-07-23 14:09 883次阅读
高云半导体小蜜蜂家族再添新成员——GW1NS-2...

基于INTEL FPGA硬浮点DSP实现卷积运算...

卷积是一种线性运算,其本质是滑动平均思想,广泛应用于图像滤波。而随着人工智能及深度学习的发展,卷积也...

发表于 2018-07-23 09:09 627次阅读
基于INTEL FPGA硬浮点DSP实现卷积运算...

美高森美PolarFire 现场可编程逻辑器件产...

美高森美公司(Microsemi)宣布提供全新成本优化PolarFire 现场可编程逻辑器件(FP...

发表于 2018-07-22 12:54 93次阅读
美高森美PolarFire 现场可编程逻辑器件产...

英特尔Cyclone 10系列现场可编程门阵列,...

为支持日益增多的物联网(IoT)应用,英特尔公司今天发布了英特尔 Cyclone 10 系列现场可...

发表于 2018-07-22 12:51 161次阅读
英特尔Cyclone 10系列现场可编程门阵列,...

莱迪思半导体推出全新的模块化IP核,能为客户提供...

莱迪思半导体公司推出7款全新的模块化IP核,支持屡获殊荣的CrossLink FPGA产品系列,可...

发表于 2018-07-22 12:09 69次阅读
莱迪思半导体推出全新的模块化IP核,能为客户提供...

FPGA的设计主要是以时序电路为主吗?

“时钟是时序电路的控制者” 这句话太经典了,可以说是FPGA设计的圣言。FPGA的设计主要是以时序电...

发表于 2018-07-21 10:55 364次阅读
FPGA的设计主要是以时序电路为主吗?

为什么要学习FPGA?如何学习FPGA?

我知道,我对与电子有关的所有事情都很着迷,但不论从哪个角度看,今天的现场可编程门阵列(FPGA),都...

发表于 2018-07-21 10:49 403次阅读
为什么要学习FPGA?如何学习FPGA?

赛灵思收购深鉴科技的意义是什么?

7月18日早间消息,赛灵思今天宣布已经完成对中国AI芯片创企深鉴科技的收购。深鉴科技是一家总部位于北...

发表于 2018-07-20 10:33 611次阅读
赛灵思收购深鉴科技的意义是什么?

中国芯片初创公司深鉴科技对外正式宣布被FPGA巨...

深鉴科技在业内素有“中国英伟达”之称,成立初姚颂便表示,深鉴是一个解决方案的提供商,类似于一个制作D...

发表于 2018-07-20 10:26 507次阅读
中国芯片初创公司深鉴科技对外正式宣布被FPGA巨...

以FPGA为基础的嵌入式图像监控系统的设计方案详...

目前,图像监控系统大多采用PC和视频采集卡作为系统主要部分,基于嵌入式技术的图像监控系统设备在我国...

发表于 2018-07-19 18:04 172次阅读
以FPGA为基础的嵌入式图像监控系统的设计方案详...

FPGA 原型设计及发展趋势介绍

FPGA 原型设计人员艰苦努力所得的明显回报就是 ASIC 设计可以及时而毫无问题地完成产品定案(t...

发表于 2018-07-19 11:33 71次阅读
FPGA 原型设计及发展趋势介绍

自动驾驶的芯片竞赛正在愈演愈烈

英特尔近日宣布计划收购小型芯片制造商eASIC,这是英特尔继2015年以167亿美元收购Altera...

发表于 2018-07-19 10:42 470次阅读
自动驾驶的芯片竞赛正在愈演愈烈

如何来设计针对FPGA系统电源

FPGA被应用于通信、汽车、工业、医疗、视频和国防等,但是所有设计的一个共同特性就是它们全都需要电源...

发表于 2018-07-19 09:13 895次阅读
如何来设计针对FPGA系统电源

瑞萨电子发布新型全数字 DC/DC 控制器—IS...

具有丰富功能的ISL68300和ISL68301为FPGA、DSP、ASIC以及网络处理器提供高达八...

发表于 2018-07-18 15:12 907次阅读
瑞萨电子发布新型全数字 DC/DC 控制器—IS...

高速数据转换器实现方案中使用LVDS的应用诀窍和...

采用单端CMOS数字信号时,逻辑电平以大约1 V/nS的速度移动,典型输出负载为10 pF(最大值)...

发表于 2018-07-17 08:41 430次阅读
高速数据转换器实现方案中使用LVDS的应用诀窍和...

自制CPU(一)单周期

发表于 2018-07-16 09:20 332次阅读
自制CPU(一)单周期

自制CPU(二)多周期

发表于 2018-07-16 09:20 277次阅读
自制CPU(二)多周期

自制CPU(三)流水线

发表于 2018-07-16 09:20 273次阅读
自制CPU(三)流水线

自制CPU(四)程序编写

在我们设计出来前边三种CPU之后,我们来进行程序的编写。 所谓程序的编写,就是;利用我们写好的CPU...

发表于 2018-07-16 09:20 543次阅读
自制CPU(四)程序编写