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TL16C554 具有 16 字节 FIFO 的四路 UART

数据:

描述

TL16C554和TL16C554I是TL16C550B异步通信元件(ACE)的增强型四倍版本。每个通道对从外围设备或调制解调器接收的数据字符执行串行到并行转换,并对由CPU传输的数据字符进行并行到串行转换。在功能操作期间,CPU可以随时读取四重ACE的每个通道的完整状态。获得的信息包括所执行操作的类型和条件以及遇到的任何错误条件。

TL16C554和TL16C554I四重ACE可以置于备用FIFO模式,激活内部FIFO以允许16个字节(在接收器FIFO中每字节加三位错误数据)以接收和发送模式存储。为了最小化系统开销并最大化系统效率,所有逻辑都在芯片上。两个终端功能允许直接存储器访问(DMA)传输的信令。每个ACE都包含一个可编程波特率发生器,可以将定时参考时钟输入除以1和(2 16 -1)之间的除数。

TL16C554和TL16C554I可用采用68引脚塑料引线芯片载体(PLCC)FN封装和80引脚(TQFP)PN封装。

特性

  • 集成异步通信元素
  • 由四个改进的TL16C550 ACE加上转向逻辑组成
  • 在FIFO中模式,每个ACE发送器和接收器都使用16字节FIFO缓冲,以减少CPU中断次数
  • 在TL16C450模式下,保持和移位寄存器无需CPU和串行数据之间的精确同步
  • 最高16 MHz时钟速率,最高可达1 Mbaud操作
  • 可编程波特率发生器,允许将任意输入参考时钟分频为1至(2 16 -1)并生成内部16×时钟
  • 向串行数据流添加或删除标准异步通信位(启动,停止和奇偶校验)
  • 独立控制的传输,接收,线路状态和数据集中断
  • 完全可编程串行接口特性:
    • 5-,6-,7-或8-位字符
    • 偶数,奇数或无奇偶校验位
    • 1-,1 1 /2- ,或2位停止位生成
    • 波特生成(DC至1-Mbit /秒)
  • 错误启动位检测
  • 完整的状态报告功能
  • 断线生成和检测
  • 内部诊断功能:
    • 通信链路故障隔离的环回控制
    • 中断,奇偶校验,溢出,帧错误模拟
  • 完全优先中断系统控制
  • 调制解调器控制功能(CTS \,RTS \,DSR \,DTR \, RI \和DCD \)
  • 三态输出为双向数据总线和控制总线提供TTL驱动能力

参数 与其它产品相比 UART

 
Number of Channels (#)
FIFOs (bytes)
Rx FIFO Trigger Levels (#)
Tx FIFO Trigger Levels (#)
Programmable FIFO Trigger Levels
CPU Interface
Baud Rate (max) at Vcc = 1.8V and with 16X Sampling (Mbps)
Baud Rate (max) at Vcc = 2.5V and with 16X Sampling (Mbps)
Baud Rate (max) at Vcc = 3.3V and with 16X Sampling (Mbps)
Baud Rate (max) at Vcc = 5.0V and with 16X Sampling (Mbps)
Operating Voltage (V)
Auto RTS/CTS
Rating
Operating Temperature Range (C)
Package Group
TL16C554
4    
16    
4    
N/A    
No    
X86    
N/A    
N/A    
N/A    
1    
5    
No    
Catalog    
-40 to 85
0 to 70    
LQFP
PLCC    

方框图 (1)

技术文档

数据手册(1)
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