PCIe接口与AXI接口的特性介绍

PCIe-AXI-Controller

PCIe-AXI-Controller兼容PCI Express Base Specification Revision 3.1，实现PCIe PHY Layer，Data Link Layer以及Transaction Layer的所有功能特性，不仅内置DMA控制器，而且具备AXI4用户接口，提供一个高性能，易于使用，可定制化的PCIe-AXI互连解决方案，同时适用于ASIC和FPGA。

PCIe接口

PHY Interface for PCI Express（PIPE）：PIPE 4.4和PIPE 5.1

可与PIPE兼容的PHY集成

AXI接口：

1个AXI4-Lite Master接口

1个AXI4-Lite Slave接口

1个AXI4-MM Master描述符接口

4个AXI4-MM Master接口

4个AXI4-MM Slave接口

4个AXI4-Stream Master接口

4个AXI4-Stream Slave接口

PCIe特性：

支持PCIe Gen1（2.5GT/s），PCIe Gen2（5.0GT/s）和PCIe Gen3（8.0GT/s）

支持PCIe x16，x8，x4，x2和x1

支持Endpoint和Rootport模式

支持SR-IOV功能，VF可达512个

支持32个MSI和INT消息

支持MSI-X

支持ASPM：L0s和L1

AXI特性：

访问外部配置寄存器

访问内部配置寄存器

访问SGDMA描述符

访问AXI4 Slave设备

被AXI4 Master设备访问

访问AXI4 Stream Slave设备

被AXI4 Stream Master设备访问

DMA特性：

8个独立的DMA引擎

支持CDMA和SGDMA

可交付资料：

详细的用户手册

Design File：Post-synthesis EDIF netlist or RTL Source

Timing and layout constraints，Test or Design Example Project

技术支持：邮件，电话，现场，培训服务

责任编辑:tzh