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CPU+FPGA的图片压缩异构加速方案效率提升14倍

2017年09月26日 16:44 次阅读

  现阶段CPU和FPGA互相配合工作已经有一段时间了,借助由GPU、FPGA和其他智能引擎等协处理器与CPU一起组成的异构计算平台来提升计算性能,已成为当下学术界和工业界的研究热点。下面我们一起来看看CPU+FPGA在图片数据存储系统中的应用。

  随着移动互联网的发展,图片正在成为日常资讯中重要的组成部分,从一定程度上来讲我们已经进入了“读图”时代。根据研究表明,全球设备产生的互联网数据规模在2019年预计达到每月24.3EB,其中,60%的数据流量来源于图片。“读图时代”尤其是“大图时代”,这么多高质量的图片存在哪?存储成本急剧上升怎么解?

  WebP图像有损压缩FPGA异构加速方案,能够实现JPEG-WebP图片格式的快速转换,相比传统方案转换效率最高能提升14倍,能够支撑更高并发密度的图片实时检索、传输等任务。

  用计算能力“换取”存储空间

  目前,互联网主流的图片格式包括JPEG、GIF等,但是由于压缩比小,导致图片数据存储占用了过多的服务器存储资源。

  CPU+FPGA的图片压缩异构加速方案效率提升14倍

  WebP格式能够大大缩小图片文件大小

  为此,谷歌发布了新的图片有损压缩格式——WebP,能在保证图像质量的前提下,数据大小相比JPEG降低39.8%,相比PNG降低26%,相比GIF降低64%。使用WebP格式图片后页面平均传输时间减少33%,网页加载时间降低10%。

  在国内,腾讯的新闻客户端、QQ空间等也开始尝试向WebP切换,流量峰值带宽可以降低9GB,图片的延时和数据下载延时降低100ms。但是WebP的应用落地仍存在门槛,因为WebP其实是需要用计算能力“换取”存储空间。

  由于采用了更复杂的压缩算法,与JPEG相比,WebP格式图片的编解码过程都需要消耗更多的计算资源,导致处理效率低10倍甚至更多。并且,CPU在处理高并行任务时并不那么高效,因此研发出一种更高效的图片编解码加速硬件是WebP快速落地的关键。

  FPGA加速压缩算法,整体性能可提升14倍

  单一图片的编解码对于计算设备而言是一种小计算量任务,但是这种任务并发很多,同一时间要处理的图片的数量多。如果使用串行计算的CPU来处理,处理效率就会受限于时钟频率。

  因此,浪潮采用并行计算能力强的计算平台FPGA来进行图片编解码,通过把高性能计算算法中固有的并行运算部分硬件化来实现应用加速。在处理大规模并发任务时,可以提供更多管道,也就是说可以同时并行执行大量的指令。因而通过合理的配置,FPGA可以同时执行大量的数据吞吐操作,在这种情况下,该设备相当于多个传统CPU在同时工作。

  浪潮WebP图像压缩FPGA异构加速方案,基于浪潮研发的业界最高密度的FPGA卡-F10A。并针对图片数据的压缩任务,嵌入基于FPGA计算环境下的WebP编解码优化算法,通过充分利用硬件流水设计和任务级并行,大大提升WebP图像压缩编码算法的处理性能。

  CPU+FPGA的图片压缩异构加速方案效率提升14倍

  浪潮实测数据显示FPGA方案相比传统方案效率提升14倍以上

  根据浪潮实测,采用浪潮WebP图像压缩FPGA解决方案,与传统实现方式相比,在JPEG格式转WebP格式任务下,这一解决方案相比传统CPU方案,整体处理效率平均提高9.13倍左右,最高性能可比CPU提高14倍!这意味着,图片数据存储所需要的服务器数量减少近一半,且能够支撑更高并发密度的图片检索、传输等任务。

  举个实测例子,输入1200张2048&TImes;1536分辨率的JPEG图片,使用双路Xeon E5-2690v3服务器来进行WebP格式转码,共需要33.4秒,每秒能够处理35张。而使用浪潮FPGA加速方案则只需要2.39秒,每秒能够处理502张,加速比达到14.37倍!

  当今社会,图片已经成为互联网不可或缺的元素,在电子商务、即时通讯、图片搜索、生活服务、社交平台等领域,图片所占的比重也逐渐增大,图片存储和分发对于数据中心运营成本的压力也居高不下,采用浪潮WebP图像压缩FPGA方案,将能够有效提升WebP格式图片转码效率,进而提升网站、App的图片速度,降低后台存储所需硬件资源。

  目前,浪潮已经在WebP图像压缩、Gzip数据压缩和残差网络-ResNet等方向推出了相应的FPGA解决方案,相比传统应用实现方式,浪潮FPGA方案具有极高的性能功耗比优势。后续,浪潮将继续深入研发基于FPGA的通用系统方案,包括深度学习、网络加速、存储优化等,并将方案推广到其它应用领域和客户。未来,CPU+FPGA或许将作为新的异构加速模式,被越来越多的数据中心、互联网深度学习等越来越多的应用领域采用。

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在内存复制过程中,面对大数据量的转移时利用DMA。所以,我们使用输入捕获事件触发DMA来搬运寄存器而...

发表于 2018-03-13 10:02 1487次阅读
用STM32测量频率和占空比的几种方法

人眼仿生学原理设计一种嵌入式的微型3D图像传感器

3D图像传感器系统结构包含两只CMOS型图像传感器及缓存图像数据的SDRAM,为了对两只图像传感器...

发表于 2018-03-13 09:55 570次阅读
人眼仿生学原理设计一种嵌入式的微型3D图像传感器

AS配置方式由FPGA器件引导配置操作过程

JTAG模式在线下载FPGA的原理如图7.15所示,PC端的Quartus II软件通过下载线缆将b...

发表于 2018-03-13 09:46 491次阅读
AS配置方式由FPGA器件引导配置操作过程

Linux跟踪器如何选择,学会这招就很简单了

跟踪器tracer是一个高级的性能分析和调试工具,如果你使用过 strace或者 tcpdump,你...

发表于 2018-03-12 15:45 411次阅读
Linux跟踪器如何选择,学会这招就很简单了

献给那些刚刚踏上硬件之路的同学们:硬件开发经验

在进行FPGA学习的时候,我遇到过问题停滞不前,试验没有进展,心情沮丧的时候。那时对底层硬件一无所知...

发表于 2018-03-12 14:18 846次阅读
献给那些刚刚踏上硬件之路的同学们:硬件开发经验

FPGA设计的经验技巧,FPGA开发设计经验总结

FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在P...

发表于 2018-03-12 10:35 562次阅读
FPGA设计的经验技巧,FPGA开发设计经验总结

FPGA控制的无人机电源管理系统

工业电子产品的发展趋势是更小的电路板尺寸、更时尚的外形和更具成本效益。由于这些趋势,电子系统设计人员...

发表于 2018-03-12 09:48 2943次阅读
FPGA控制的无人机电源管理系统

如何用面包版绕线做原型CPU?

基于74HC系列的CMOS积体电路,插在面包板上用电线跳接起来,他花了两天时间画电路图、一个星期时间...

发表于 2018-03-12 09:21 190次阅读
如何用面包版绕线做原型CPU?

AI领域芯片已“炒作”过热但AI芯片未来发展还有...

华大学微电子所所长魏少军9日呼吁,当前,AI领域芯片已“炒作”过热,在目前还没有出现AI通用算法的芯...

发表于 2018-03-12 09:16 575次阅读
AI领域芯片已“炒作”过热但AI芯片未来发展还有...

如何制作一个CPU

能对指令进行译码并执行规定的动作;可以进行算术和逻辑运算;能与存储器,外设交换数据;提供整个系统所需...

发表于 2018-03-12 09:03 117次阅读
如何制作一个CPU

详解DDR布线最简规则与过程

星形拓补就是地址线走到两片DDR中间再向两片DDR分别走线,菊花链就是用地址线把两片DDR“串起来”...

发表于 2018-03-12 08:36 1590次阅读
详解DDR布线最简规则与过程

cpu执行指令的过程详解

计算机每执行一条指令都可分为三个阶段进行。即取指令-----分析指令-----执行指令。

发表于 2018-03-09 16:30 742次阅读
cpu执行指令的过程详解

大师教你如何制作一个简单的16位CPU

与mv指令类似,mvi指令也将一个数据送入Rx当中,只不过这次的数据存在指令当中,是立即数,所以Rx...

发表于 2018-03-09 14:23 866次阅读
大师教你如何制作一个简单的16位CPU

初学者爱问这个问题,FPGA到底能做什么?

各种方案虽然只是初步的了解一些,但是发现这方面虽然有类似SOPC概念的海思和TI双核解决方案,而且是...

发表于 2018-03-09 14:19 651次阅读
初学者爱问这个问题,FPGA到底能做什么?

当单片机遇到多个模块的数据需要处理,应该怎么办?

将硬件系统区分为独立单元单独做成底层驱动函数和应用函数,并且函数正常应该有参数和返回值,其中返回值是...

发表于 2018-03-09 13:51 760次阅读
当单片机遇到多个模块的数据需要处理,应该怎么办?

指令周期的四个阶段详解

指令周期是取出一条指令并执行这条指令的时间。一般由若干个机器周期组成,是从取指令、分析指令到执行完所...

发表于 2018-03-09 10:51 703次阅读
指令周期的四个阶段详解