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总线的操作时序和操作方式详解

FPGA之家 来源:YXQ 2019-06-24 16:21 次阅读

操作时序(timing):各信号有效的先后顺序及配合关系

(1) 同步方式

•发送、接收双方统一步调,具备统一的时钟信号。•完全由同步时钟确定收发时刻,没有应答信号。•例:总线的读操作

(2) 异步方式

•发送、接收双方根据自身的工作速度来确定总线传送的步调•没有统一的时钟信号,有主同步MSYN和从同步SSYN

•MSYN上升沿:主设备启动输入•SSYN上升沿:从设备已将数据准备好;•MSYN下降沿:主设备已将数据取走;•SSYN下降沿:从设备让出数据总线•特点:各设备以自身需要的速度工作,时间利用率高。

·事件C: Ssyn↑→Msyn↓

·事件R: Msyn↓ → Ssyn ↓

·全互锁:有C且有R

·半互锁:或有C、或有R

(3) 准同步方式在完全同步方式中加一点异步的手段。有同步时钟,也有应答信号线。同步地采样应答信号

总线操作方式

微机系统各部件之间的信息交换是通过总线操作周期完成的,一个总线周期通常分为以下四个阶段。

① 总线请求和仲裁阶段:当有多个模块提出总线请求时,必须由仲裁机构仲裁,确定将总线的使用权分配给哪个模块。

② 寻址阶段:取得总线使用权的模块,经总线发出本次要访问的存储器或I/O端口的地址和有关命令。

③ 传送数据阶段:主模块(指取得总线控制权的模块)与其他模块之间进行数据的传送。

④ 结束阶段:主模块将有关信息从总线上撤除,主模块交出对总线的控制权。

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原文标题:总线的操作时序和操作方式详解

文章出处:【微信号:zhuyandz,微信公众号:FPGA之家】欢迎添加关注!文章转载请注明出处。

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