正点原子开拓者FPGA:SDRAM读写测试实验（3）-电子发烧友网

正点原子开拓者FPGA:SDRAM读写测试实验（3）

SD RAM有一个同步接口，在响应控制输入前会等待一个时钟信号，这样就能和计算机的系统总线同步。时钟被用来驱动一个有限状态机，对进入的指令进行管线(Pipeline)操作。这使得SDRAM与没有同步接口的异步DRAM(asynchronous DRAM)相比，可以有一个更复杂的操作模式。

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