基于TSC2101与I2S总线的音频系统的设计与实现

电子设计 2018-12-06 08:33 次阅读

近年来掀起了嵌入式系统应用的热潮,嵌入式系统已经渗透到我们生活中的每个角落,工业、服务业、消费电子等等。Windows CE是一个开放的、可裁剪的、32位的实时嵌入式操作系统。它具有可靠性好、实时性高、内核体积小的特点,被广泛用于各种嵌入式智能设备的开发;在这些嵌入式应用中,音频模块成为了大多数产品不可或缺的一部份。

音频系统的硬件实现

本设计中的音频驱动采用Unified Audio模型实现,基于Intel Xscale PXA272处理器和TI 的TSC2101音频芯片,使用了基于I2S(Inter-IC Sound)总线的音频系统体系结构,系统原理图如图1所示。Intel Xscale PXA272芯片集成了I2S控制器,通过I2S总线处理音频数据。

基于TSC2101与I2S总线的音频系统的设计与实现

图1 系统原理图

I2S是菲利浦公司提出的串行数字音频总线协议。PXA272的I2S控制器控制了I2S链接,I2S控制器由数据缓冲、状态和控制寄存器、计数器组成。它们将系统内存和外设的音频解码芯片(TSC2101)连接,产生同步音频。播放音频文件时,I2S控制器通过I2SLINK连接将系统内存中数字化的声音样本发送到外设的TSC2101音频解码芯片中,然后由TSC2101芯片的数模转换器将数字音频信号转换成模拟信号。

I2S控制器通过DMA方式来访问。DMA方式下,DMA控制器只能通过串行音频数据寄存器(SADR)访问FIFO。DMA控制器通常以8、16或32字节大小的块存取FIFO队列数据的。

本设计中采用的音频芯片TSC2101集成了立体声音频解码、触摸屏控制芯片,立体声DAC能以高达48Kb/s的采样率播放音频文件,专供PDA、PMP、智能手机和MP3播放机使用。TSC2101 将扬声器放大器、耳机放大器和四线触摸屏控制器音频编解码器集成再一起,带有一个立体声头戴送受话器接口、一个手机送受话器接口、一个单声道8Ω扬声器放大器以及一个32Ω受话器驱动器,并集成有一个电池监控器和一个片上温度传感器

TSC2101芯片的电路设计如图2所示。

基于TSC2101与I2S总线的音频系统的设计与实现

图2 TSC2101芯片电路设计

本设计为TSC2101在智能手机中的运用,CP-IN为通信模块的语音输入,CP-OUT则为音频系统到通信模块的输出,在实际的应用中MIC1可以通过TSC2101的内部PGA(可编程增益放大)、AGC(自动增益控制)电路连接到CP-OUT,实现智能手机的话筒功能;同时,MIC1输入还可以通过内部的ADC将语音数据采样后经I2S总线传输到处理器存储空间实现录音功能。当然,在智能手机通话的同时,还可以实现通话录音功能。电路图中的38~41引脚为SPI接口,42~46引脚为I2S控制引脚,引脚9~12为触摸屏输入,引脚27和28为音频输出可以连接耳机,引脚26连接手机听筒,引脚33、35连接外置扬声器。

采用Unified Audio模型实现音频驱动

音频驱动的一种方法,是采用Unified Audio模型,即不分层的音频驱动模型,这种模型的音频驱动支持标准的波形驱动接口。在分层的音频驱动中,驱动程序由MDD和PDD组成,MDD层执行与硬件平台无关的功能,PDD层则是直接与硬件平台相关的操作,而在Unified Audio模型中,MDD和PDD的分层是不必要的,图3是Unified Audio模型的音频驱动结构。

基于TSC2101与I2S总线的音频系统的设计与实现

图3 Unified Audio模型的音频驱动结构

在这种模型下,音频驱动仍然是以流接口的形式实现,分别实现了WAV-close()、WAV-PowerDown()、WAV-Deinit()、 WAV-PowerUp()、WAV-Init()、WAV-Read()、WAV-IOControl()、WAV-Seek()、WAV-Open()、WAV-Write()这几个标准的流接口函数。

DMA缓存区设计与实现

由于音频设备驱动程序设计对设备的实时性要求较高,所以DMA缓存区设计以及合理地利用缓存区加快对音频数据的处理,减少延时变得十分重要。

DMA控制器是使CPU处理其他与数据总线无关的处理,而由DMA控制器负责数据传输的机制,这种机制使得CPU从繁重的数据传输中解脱出来,可以执行其他计算,从而提高了系统运行速度。PXA272的DMA控制器提供了32个DMA通道,0~31。这些通道提供了flow-through 和fly by的数据传输方式。

在本设计中,使用双缓存区DMA通道设计,如图4所示,当CPU正在处理某一个缓存区数据的同时,DMA控制器可以完成另一个缓存区数据的传输,如此交替下去,则可以提高系统的并行能力,提高音频处理的实时性。

本设计中使用MapDMABuffers()函数实现DMA音频数据缓存区的分配,函数主要实现的功能是:分配接收和发送音频数据的DMA缓存区。

结束语

本文分析了嵌入式Windows CE操作系统基于TSC2101音频芯片的音频系统实现的基本原理及其驱动程序模型;并结合具体程序重点描述了DMA双缓存区的实现方法和原理,本设计在实际运用中能够满足音频系统的实时性要求。

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发表于 11-02 19:27 2次 阅读
DRA797 适用于音频放大器且带 DSP 的 800MHz ARM Cortex-A15 SoC 处理器

DRA712 用于信息娱乐系统和仪表组且带图形功能的 600MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

发表于 11-02 19:27 6次 阅读
DRA712 用于信息娱乐系统和仪表组且带图形功能的 600MHz ARM Cortex-A15 SoC 处理器

DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA79x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS设备的更多信息,请联系您的TI代表。 DRA79x Jacinto 6 RSP(无线电声音处理器)设备系列符合AEC-Q100标准。 设备具有简化的电源...

发表于 11-02 19:27 0次 阅读
DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。

发表于 11-02 19:27 0次 阅读
DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA72x(“Jacinto 6 Eco”)信息娱乐应用处理器采用与Jacinto 6设备相同的架构开发,以满足现代信息娱乐系统的强烈处理需求 - DRA72x器件为DRA74x器件提供了向上的可扩展性,同时在整个系列中引脚兼容,允许原始设备制造商(OEM)和原始设计制造商(ODM)快速实现创新连接技术,语音识别,音频流等。 Jacinto 6和Jacinto 6 Eco设备通过完全集成的混合处理器解决方案的最大灵活性带来高处理性能。 可编程性由具有Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为ARM提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行情况的调试接口。 DRA72x Jacinto 6 Eco处理器系列符合AEC-Q100标准。 特性 为信息娱乐应用而设计的架构 视频,图像和图形处理支持 全高清视频(1920×1080p,60 fps) 多视频输入和视频输出 2D和3D图形 ARM < sup>® Cortex ® -A15微处理器子系统 C66x浮点VLIW DSP 完全对象代码与C67x和...

发表于 11-02 19:27 4次 阅读
DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

发表于 11-02 19:27 9次 阅读
DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

发表于 11-02 19:27 13次 阅读
DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 3次 阅读
DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合技术),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉技术。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...

发表于 11-02 19:27 4次 阅读
TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 0次 阅读
DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合技术),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉技术。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...

发表于 11-02 19:27 0次 阅读
TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 34次 阅读
DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA756 Jacinto 汽车电子应用处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。 最多两个嵌入式视觉引擎(EVE) IVA子系统 显示子系统 使用DMA引擎显示控制器,最多三个管道 HDMI™编码器:符合HDMI 1.4a和DVI 1.0 视频处理引擎(VPE) 2D-Graphics加速器(BB2D)子系统 Vivante ® GC320核心 双核PowerVR ® SGX544 3D GPU 三个视频输入端口(VIP)模块 支持多达10个多路复用输入端口 通用内存控制器(GPMC) 增强型直接内存访问(EDMA)控制器 2端口千兆以太网(GMAC) 十六32 -Bit通用定时器 32位MPU看门狗定时器 五个内部集成电路(I 2 C)端口 HDQ™/1-Wire ®接口 SATA接口 媒体本地总线(MLB)子系统 十个可配置UART /IrDA /CIR模块 四个多通道串行外设接口(McSPI) Quad SPI(QSPI) 八个多通道音频串行端口(McASP)模块 SUPERS peed USB 3.0双重角色设备 三个高速USB 2.0双重角色设备 四个多媒体卡/安全数字/安全数字输入输出接口(MMC™/SD ® /SDIO) PCI-Express ®...

发表于 11-02 19:27 2次 阅读
DRA756 Jacinto 汽车电子应用处理器

SMJ320C6415 定点数字信号处理器

TMS320C64x ?? DSP(包括SMJ320C6414,SMJ320C6415和SMJ320C6416器件)是TMS320C6000中性能最高的定点DSP产品? DSP平台。 TMS320C64x ?? (C64x ?? )设备是基于第二代高性能,先进的VelociTI ??德州仪器(TI)开发的超长指令字(VLIW)架构(VelociTI.2 ??),使这些DSP成为多通道和多功能应用的绝佳选择。 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件以720 MHz的时钟速率提供高达57.6亿条指令/秒(MIPS)的性能,可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能。 C64x ?? DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元 - 两个乘法器用于32位结果和六个算术逻辑单元(ALU)??用VelociTI.2 ??扩展。 VelociTI.2 ??八个功能单元中的扩展包括新的指令,以加速关键应用程序的性能,并扩展VelociTI的并行性?建筑。 C64x每周期可产生4个32位乘法累加(MAC),总计每秒2400万MAC(MMACS),或每周期8个8位MAC,总计4800 MMACS。 C64x DSP还具有特定于应用的硬件逻...

发表于 11-02 18:50 2次 阅读
SMJ320C6415 定点数字信号处理器

AM5718-HIREL AM5718-HIREL Sitara™ 处理器器件版本 2.0

AM5718-HIREL Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM5718-HIREL器件通过其极具灵活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 采用配有Neon™扩展组件的单核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核,可提供编程功能。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离开来,从而降低系统软件的复杂性。 此外,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器,用在简化编程和调度的DSP汇编优化器,可查看源代码执行情况的调试界面等。 AM5718-HIREL Sitara ARM处理器系列符合AEC-Q100标准。 特性 有关器件版本1.0的详细信息,请参阅SPRS919 ARM®Cortex®-A15微处理器子系统 数字信号处理器(DSP) 目标代码与C67x和C64x +完全兼容 每周期最多32次16 x 16位定点乘法 高达512KB的片上L3 RAM 3级(L3)和4级(L4)互连 DDR3 /DDR3L存储器接口(EMIF)模块 ...

发表于 11-02 18:49 0次 阅读
AM5718-HIREL AM5718-HIREL Sitara™ 处理器器件版本 2.0

SM320C6457-HIREL 通信基础设施数字信号处理器

的TMS320C64x +™DSP(包括SM320C6457-HIREL器件)是TMS320C6000DSP平台上的高性能定点DSP系列产品.SM320C6457-HIREL器件基于德州仪器(TI)开发的第3代高性能,高级VelociTI超长指令字(VLIW)架构,这使得该系列DSP非常适合包括视频和电信基础设施,成像/医疗以及无线基础设施(WI)在内的各类应用。 C64x +器件向上代码兼容属于C6000™DSP平台的早期器件。 基于65nm的工艺技术以及凭借高达96亿条指令每秒(MIPS)[或9600 16位MMAC每周期]的性能( 1.2GHz的时钟速率时),SM320C6457-HIREL器件提供了一套应对高性能DSP编程挑战的经济高效型解决方案.SM320C6457-HIREL DSP可以灵活地利用高速控制器以及阵列处理器的数值计算能力。 C64x + DSP内核采用8个功能单元,2个寄存器文件以及2个数据路径。与早期C6000器件一样,其中2个功能单为乘法器或.M单元.C64x内核每个时钟周期执行4次16位×16位乘法累加,相比之下,C64x + .M单元的乘法吞吐量可增加一倍。因此,C64x +内核每个周期可以执行8次16位×16位MAC。采用1.2GHz时钟速率时,这意味着每秒可以执行9600次1...

发表于 11-02 18:48 7次 阅读
SM320C6457-HIREL 通信基础设施数字信号处理器

SN74LVC646A 具有三态输出的八路总线收发器和寄存器

SN54LVC646A八路总线收发器和寄存器设计用于2.7 V至3.6 VVCC操作,SN74LVC646A八路总线收发器和寄存器设计用于1.65V至3.6VVCC操作。 这些器件由总线收发器电路,D型触发器和控制电路组成用于直接从输入总线或内部寄存器多路传输数据。 A或B总线上的数据在适当时钟(CLKAB或CLKBA)输入的低到高转换时被输入寄存器。图1显示了使用?? LVC646A器件执行的四种基本总线管理功能。 输出使能(OE)和方向控制(DIR)输入控制收发器功能。在收发器模式下,高阻抗端口的数据存储在任一寄存器或两者中。 选择控制(SAB和SBA)输入可以复用存储的和实时(透明模式)数据。当OE \低时,DIR确定哪个总线接收数据。在隔离模式(OE \ high)中,A数据存储在一个寄存器中,B数据可以存储在另一个寄存器中。 当禁用输出功能时,输入功能仍然有效,并且可以用于存储和传输数据。一次只能驱动两条总线A或B中的一条。 输入可以从3.3 V或5 V器件驱动。此功能允许在混合的3.3 V /5 V系统环境中将这些器件用作转换器。 这些器件完全指定用于部分断...

发表于 10-09 17:08 6次 阅读
SN74LVC646A 具有三态输出的八路总线收发器和寄存器

SN74HCT652 具有三态输出的八路总线收发器和寄存器

 HCT652器件由总线收发器电路,D型触发器和控制电路组成,用于直接从数据中复用数据传输总线或从内部存储寄存器。提供输出使能(OEAB和OEBA \)输入以控制收发器功能。提供选择控制(SAB和SBA)输入以选择实时或存储的数据传输。低输入电平选择实时数据;高输入级别选择存储的数据。图1显示了可以使用这些器件执行的四种基本总线管理功能。 A或B数据总线上的数据或两者都可以存储在内部D型触发器中无论选择控制端子还是输出控制端子,在适当的时钟(CLKAB或CLKBA)端子上都会发生从低到高的跳变。当SAB和SBA处于实时传输模式时,通过同时启用OEAB和OEBA \,可以在不使用内部D型触发器的情况下存储数据。在此配置中,每个输出都会增强其输入。当两组总线的所有其他数据源都处于高阻态时,每组总线保持最后状态。 为确保上电或断电期间的高阻态,OEBA \应通过上拉电阻连接到VCC,OEAB应通过下拉电阻连接到GND;电阻的最小值由驱动器的电流吸收/电流源能力决定。 特性 工作电压范围4.5 V至5.5 V 低功耗,80-μA...

发表于 10-09 17:06 6次 阅读
SN74HCT652 具有三态输出的八路总线收发器和寄存器