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FPGA电源设计部分电路原理图解析

2020-11-18 11:25 次阅读

U22是电可擦除ROM,用于存放AS下载后的数据,使得FPGA的程序段掉电也能得以保存,DATA端是数据读取端,用于读取ROM内数据。DCLK为时钟端口,用于接收时钟信号进行同步传输。nCS是片选端口,用于接收片选信号表示对该芯片进行通讯。ASDI为AS下载数据输入端,用于接收AS下载数据。VCC与GND分别为电源端口与地端口,分别接3.3V与数字地。

FPGA电源设计部分电路原理图如图5-1所示:

Header18X2为18排2列排阵,两组排阵分别与PIN口、3.3V电源、数字地相连,提供了可动的机制,使得PIN口可根据需要用排线与目标相连,打到信号传输的目的。而3.3V电源以及数字地针口则可以根据需要,用排线为目标提供逻辑高电平或逻辑低电平。

U21D为FPGA芯片的时钟信号接收部分,通过网络标号“CLK0~3”与对应的时钟信号端口相连。

U21B为JTAG与AS下载部分,TMS、TCK、TD1、TD0分别为JATAG下载方式的模式选择端、时钟信号端、数据输入端、数据输出端。DATA0为AS下载的数据端口,MSEL0、MSEL1、nCE、nCEO、CONF_DONE、nCONFIG、nSTATUS端口按照典型接法相连。值得注意的是:无论AS还是JTAG都是通过JTAG标准通讯,AS下载一般是下载POF到PROM(flash)里,重新上电仍然可以加载,JTAG下载是通过JTAG口将sof文件直接下载到FPGA内,一般是临时调试用的,掉电就丢失了。
责任编辑人:CC

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