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新思科技公司宣布集成化混合原型验证解决方案

2018年07月02日 11:50 次阅读

     新思科技公司(Synopsys)日前宣布了一种集成化混合原型验证解决方案,它将Synopsys的Virtualizer虚拟原型验证和Synopsys基于FPGA的HAPS原型验证结合在一起,以加速系统级芯片(SoC)硬件和软件的开发。通过对新设计的功能使用Virtualizer虚拟原型技术和对重用逻辑使用基于FPGA的HAPS原型技术,设计师能够将设计周期中软件开发的起始时间提前多达12个月。此外,Synopsys的混合原型设计解决方案可确保设计师加速对硬件/软件的集成及系统验证,显著缩短了整体的产品设计周期。凭借ARM Cortex处理器的高性能模型、基于ARM AMBA协议的事务处理器以及DesignWare IP,开发者可为了最贴近他们的设计需求,而方便地将其基于ARM处理器的设计进行分割分别进入到虚拟的和基于FPGA的原型中。

新思科技公司宣布集成化混合原型验证解决方案

  目前,设计师在构建SoC原型时使用两种相对独立的方法:基于事务级模型(TLM)的虚拟原型验证和基于FPGA的原型验证。虚拟原型验证通过执行快速TLM而完美地适用于在没有RTL时加快的软件开发,并提供了更高效的纠错和脚本分析。基于FPGA的原型设计可提供周期精准和高性能的执行,以及直接真实接口连接。Synopsys的混合原型设计解决方案将Virtualizer虚拟原型和HAPS基于FPGA原型两者的优势精心调和在一起,以使软件开发和系统集成能在项目周期中更快完成。

  “不断增加的复杂性与软件内容与多核SoC关联在了一起,意味着系统工程师和软件开发者不能够等待硬件就位才开始他们的工作,因此他们越来越多地使用其芯片和系统的原型,”研究公司VDC Research的嵌入式软件及硬件副总裁 Chris Rommel说道。“Synopsys的‘混合’方法解决了单一SoC原型验证方法的许多限制,它使开发者可以随意地将RTL之前的事务级模型与已经存在或正在开发的RTL混合在一起,为设计团队的硬件及软件开发带来大幅度的提前。”

  Synopsys的混合原型验证解决方案增强了软件栈验证,这是因为通过使用Virtualizer虚拟原型可带来非常高的处理器执行速度。它通过模拟PHY或测试设备直接连接到真实世界,该I/O模型接口叠加在基于FPGA的HAPS上。此外,设计师把已有的RTL 或IP用在基于FPGA的原型和把新功能用在SystemC事务级模型中,这样的方法在项目开发中可以更快地执行和更早地实现。

  Synopsys的高性能HAPS通用多资源总线(UMRBus)物理连接,可高效地在虚拟和基于FPGA原型验证两种环境之间传输数据。预先验证的、基于HAPS的事务处理器可支持ARM AMBA 2.0 AHB/APB、AXI3、AXI-4和AXI4-Lite互联,它为设计师在虚拟或基于FPGA的原型验证环境之间分割SoC设计提供了很大的灵活性,分割可在AMBA 互联的通常的模块级边界进行。与传统基于FPGA的原型设计相比,使用混合原型中的基于Virtualizer环境的软件纠错能力,用户对正在开发的软件的寄存器和存储器文件拥有更大的可见度和控制能力。

  “混合原型方案给设计团队提供了硬件和软件两种原型设计方法必须提供的最佳优势,”Synopsys公司IP和系统市场营销副总裁John Koeter说道。“将Virtualizer虚拟原型技术的优势与HAPS基于FPGA的原型技术的优势通过UMRBus物理联接整合在一起,Synopsys可使设计师更快地、在设计周期中更早地开发出完全可运行的SoC原型,并加速了软件开发和对整个系统的验证。”

  供货

  这种混合原型验证解决方案现已可向早期采用者供货。

  在DAC 2012将演示混合原型方案

  Synopsys已在DAC 2012的 #1130展位上演示集成化混合原型验证解决方案。DAC于2012年6月3日-7日在美国加利福尼亚州旧金山市举行。

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一种基于fpga的多轴控制器,可以控制多轴电机的...

为应用选择最佳可编程SoC时进行的六个设计考虑

SoC FPGA器件在一个器件中同时集成了处理器和FPGA体系结构。将两种技术合并起来具有很多优点,...

发表于 2018-06-13 14:59 194次阅读
为应用选择最佳可编程SoC时进行的六个设计考虑

FPGA学习系列:13. 任意分频器设计

设计背景: 分频在 fpga的设计中一直都担任着很重要的角色,而说到分频,我相信很多人都已经想到了利...

发表于 2018-06-13 11:21 786次阅读
FPGA学习系列:13. 任意分频器设计

FPGA学习系列:14. 锁相环pll设计

设计背景: 在我们设计工程中我们会用到100M,500M等时钟,如果我们的晶振达不到我们就需要倍频,...

发表于 2018-06-13 11:21 1007次阅读
FPGA学习系列:14. 锁相环pll设计

FPGA学习系列:15. 呼吸灯(pwm)设计

设计背景: 呼吸灯 广泛应用于手机之上,并成为各大品牌新款手机的卖点之一。如果手机里面有未处理的通知...

发表于 2018-06-13 11:21 1198次阅读
FPGA学习系列:15. 呼吸灯(pwm)设计

FPGA学习系列:16. rom控制器设计

设计背景: ROM是只读存储器(Read-Only Memory)的简称,是一种只能读出事先所存数据...

发表于 2018-06-13 11:21 638次阅读
FPGA学习系列:16. rom控制器设计

补充: FPGA产生基于LFSR的伪随机数

大家好,又到了每日学习的时间了,上一篇《荐读:基于FPGA 的CRC校验码生成器》文中,提到了要实现...

发表于 2018-06-13 11:21 699次阅读
补充: FPGA产生基于LFSR的伪随机数

FPGA学习系列:12. 边沿检测设计

设计背景: 在我们工程设计中,有时会需要到上升沿和下降沿这么一个说法,通过上升沿和下降沿来驱动一个电...

发表于 2018-06-13 11:20 575次阅读
FPGA学习系列:12. 边沿检测设计

荐读:基于FPGA 的CRC校验码生成器

大家好,又到了每日学习的时间了,今天我们来聊一聊基于FPGA 的CRC校验码生成器。下面咱们就来具体...

发表于 2018-06-13 11:18 659次阅读
荐读:基于FPGA 的CRC校验码生成器

Web Installer提供的各种特性及设计方...

你有没有注意到在Netflix流媒体视频播放时,有时候视频模糊,然后很快恢复到高质量? 你知道Net...

发表于 2018-06-13 09:19 633次阅读
Web Installer提供的各种特性及设计方...

FPGA定点小数的常规格式、相对于浮点小数的优势...

所谓定点小数,就是小数点固定地隐含在某一位置上的数据。由于小数点的位置是固定的,所以就没有必要储存它...

发表于 2018-06-12 19:34 597次阅读
FPGA定点小数的常规格式、相对于浮点小数的优势...

如何在SDK系统中添加新的目标配置

赛灵思SDK允许您使用远程主机中的赛灵思硬件服务器来调试远程目标设备.....

发表于 2018-06-12 09:11 842次阅读
如何在SDK系统中添加新的目标配置

如何使用 Nios II 处理器进行你中意的设计...

使用 Nios II 处理器进行设计”第二部分

发表于 2018-06-11 14:36 660次阅读
如何使用 Nios II 处理器进行你中意的设计...